GPU: Added registers for depth test and cull mode.
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parent
0f929762b3
commit
c1f55c32c8
@ -280,6 +280,34 @@ public:
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UnsignedInt = 0x2,
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UnsignedInt = 0x2,
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};
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};
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enum class ComparisonOp : u32 {
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Never = 0x200,
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Less = 0x201,
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Equal = 0x202,
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LessEqual = 0x203,
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||||||
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Greater = 0x204,
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||||||
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NotEqual = 0x205,
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GreaterEqual = 0x206,
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||||||
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Always = 0x207,
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};
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struct Cull {
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enum class FrontFace : u32 {
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ClockWise = 0x0900,
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|
CounterClockWise = 0x0901,
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};
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enum class CullFace : u32 {
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Front = 0x0404,
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||||||
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Back = 0x0405,
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||||||
|
FrontAndBack = 0x0408,
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};
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u32 enabled;
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FrontFace front_face;
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CullFace cull_face;
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};
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struct Blend {
|
struct Blend {
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enum class Equation : u32 {
|
enum class Equation : u32 {
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Add = 1,
|
Add = 1,
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||||||
@ -435,11 +463,21 @@ public:
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};
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};
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} rt_control;
|
} rt_control;
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INSERT_PADDING_WORDS(0x31);
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INSERT_PADDING_WORDS(0x2B);
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u32 depth_test_enable;
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INSERT_PADDING_WORDS(0x5);
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u32 independent_blend_enable;
|
u32 independent_blend_enable;
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INSERT_PADDING_WORDS(0x15);
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u32 depth_write_enabled;
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INSERT_PADDING_WORDS(0x8);
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ComparisonOp depth_test_func;
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INSERT_PADDING_WORDS(0xB);
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struct {
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struct {
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u32 separate_alpha;
|
u32 separate_alpha;
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||||||
@ -536,7 +574,13 @@ public:
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}
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}
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||||||
} index_array;
|
} index_array;
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||||||
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INSERT_PADDING_WORDS(0xC7);
|
INSERT_PADDING_WORDS(0x7);
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||||||
|
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||||||
|
INSERT_PADDING_WORDS(0x46);
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Cull cull;
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|
INSERT_PADDING_WORDS(0x77);
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||||||
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struct {
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struct {
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||||||
u32 query_address_high;
|
u32 query_address_high;
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||||||
@ -743,13 +787,17 @@ ASSERT_REG_POSITION(vertex_buffer, 0x35D);
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|||||||
ASSERT_REG_POSITION(zeta, 0x3F8);
|
ASSERT_REG_POSITION(zeta, 0x3F8);
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||||||
ASSERT_REG_POSITION(vertex_attrib_format[0], 0x458);
|
ASSERT_REG_POSITION(vertex_attrib_format[0], 0x458);
|
||||||
ASSERT_REG_POSITION(rt_control, 0x487);
|
ASSERT_REG_POSITION(rt_control, 0x487);
|
||||||
|
ASSERT_REG_POSITION(depth_test_enable, 0x4B3);
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||||||
ASSERT_REG_POSITION(independent_blend_enable, 0x4B9);
|
ASSERT_REG_POSITION(independent_blend_enable, 0x4B9);
|
||||||
|
ASSERT_REG_POSITION(depth_write_enabled, 0x4BA);
|
||||||
|
ASSERT_REG_POSITION(depth_test_func, 0x4C3);
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||||||
ASSERT_REG_POSITION(blend, 0x4CF);
|
ASSERT_REG_POSITION(blend, 0x4CF);
|
||||||
ASSERT_REG_POSITION(tsc, 0x557);
|
ASSERT_REG_POSITION(tsc, 0x557);
|
||||||
ASSERT_REG_POSITION(tic, 0x55D);
|
ASSERT_REG_POSITION(tic, 0x55D);
|
||||||
ASSERT_REG_POSITION(code_address, 0x582);
|
ASSERT_REG_POSITION(code_address, 0x582);
|
||||||
ASSERT_REG_POSITION(draw, 0x585);
|
ASSERT_REG_POSITION(draw, 0x585);
|
||||||
ASSERT_REG_POSITION(index_array, 0x5F2);
|
ASSERT_REG_POSITION(index_array, 0x5F2);
|
||||||
|
ASSERT_REG_POSITION(cull, 0x646);
|
||||||
ASSERT_REG_POSITION(query, 0x6C0);
|
ASSERT_REG_POSITION(query, 0x6C0);
|
||||||
ASSERT_REG_POSITION(vertex_array[0], 0x700);
|
ASSERT_REG_POSITION(vertex_array[0], 0x700);
|
||||||
ASSERT_REG_POSITION(independent_blend, 0x780);
|
ASSERT_REG_POSITION(independent_blend, 0x780);
|
||||||
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